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龍圖騰網(wǎng)恭喜電子科技大學(xué)申請的專利一種ACOT控制型Buck變換器的谷值電流限產(chǎn)生電路獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN116317553B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-04-15發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202310209370.5，技術(shù)領(lǐng)域涉及：H02M3/156；該發(fā)明授權(quán)一種ACOT控制型Buck變換器的谷值電流限產(chǎn)生電路是由羅萍;范佳航;張致遠(yuǎn);趙忠;王壯壯;李成鑫設(shè)計研發(fā)完成，并于2023-03-07向國家知識產(chǎn)權(quán)局提交的專利申請。

本一種ACOT控制型Buck變換器的谷值電流限產(chǎn)生電路在說明書摘要公布了：本發(fā)明屬于集成電路技術(shù)領(lǐng)域和功率電子領(lǐng)域，具體涉及一種ACOT控制型Buck變換器的谷值電流限產(chǎn)生電路，包括誤差放大器、正谷值電流產(chǎn)生電路、負(fù)谷值電流產(chǎn)生電路、電流差分谷值限比較電路。其中誤差放大器的同相端接Buck內(nèi)部基準(zhǔn)電壓Vref，反相端接反饋電壓VFB，輸出端接正谷值電流產(chǎn)生電路和負(fù)谷值電流產(chǎn)生電路，二者分別產(chǎn)生正谷值電流和負(fù)谷值電流。電流差分谷值限比較電路將正谷值電流和負(fù)谷值電流作差得到在零值平滑切換的谷值電流限，并輸出電感電流IL和該谷值電流限的比較結(jié)果，控制功率下管關(guān)斷。應(yīng)用本發(fā)明的Buck變換器不僅可以在輕載時處于不連續(xù)導(dǎo)通狀態(tài)來獲得高效率，還可以允許電感反流，使輕載時處于連續(xù)導(dǎo)通狀態(tài)，保持低輸出紋波的特性。

本發(fā)明授權(quán)一種ACOT控制型Buck變換器的谷值電流限產(chǎn)生電路在權(quán)利要求書中公布了：1.一種ACOT控制型Buck變換器的谷值電流限產(chǎn)生電路，其特征在于，包括誤差放大器EA、正谷值電流產(chǎn)生電路、負(fù)谷值電流產(chǎn)生電路和電流差分谷值限比較電路；所述誤差放大器EA的同相端接Buck內(nèi)部基準(zhǔn)電壓Vref，反相端接Buck芯片的反饋電壓VFB，輸出端接正谷值電流產(chǎn)生電路的輸入端和負(fù)谷值電流產(chǎn)生電路的輸入端；正谷值電流產(chǎn)生電路的輸出端和負(fù)谷值電流產(chǎn)生電路的輸出端接電流差分谷值限比較電路的輸入端；電流差分谷值限比較電路的輸出端接Buck變換器的邏輯與驅(qū)動模塊；所述正谷值電流產(chǎn)生電路包括第一NMOS管MN1、第一PMOS管MP1、第二PMOS管MP2、第三PMOS管MP3、第一電阻R1、第一電流源I1；所述負(fù)谷值電流產(chǎn)生電路包括第二NMOS管MN2、第三NMOS管MN3、第四NMOS管MN4、第五NMOS管MN5、第四PMOS管MP4、第五PMOS管MP5、第六PMOS管MP6、第二電流源I2、第三電流源I3和第一電容C1；第一NMOS管MN1的柵極接誤差放大器EA的輸出端，第一NMOS管MN1的源極接第一電阻R1的一端，第一電阻R1的另一端接地，第一NMOS管MN1的漏極接第一電流源I1的一端和第二PMOS管MP2的柵極；第一電流源I1的另一端接電源；第一PMOS管MP1的柵極接第六PMOS管MP6的柵極，第一PMOS管MP1的源極接電源，第一PMOS管MP1的漏極接第二PMOS管MP2的柵極；第二PMOS管MP2的源極接電源，第二PMOS管MP2的漏極接第一NMOS管MN1的源極；第三PMOS管MP3的柵極接第二PMOS管MP2的柵極，第三PMOS管MP3的源極接電源；第四PMOS管MP4的柵極接第三PMOS管MP3的柵極，第四PMOS管MP4的源極接電源，第四PMOS管MP4的漏極接第二電流源I2的一端、第一電容C1的一端和第三NMOS管MN3的柵極；第二電流源I2的另一端和第一電容C1的另一端接地；第二NMOS管MN2的柵極接第五NMOS管MN5的源極，第二NMOS管MN2的源極接地，第二NMOS管MN2的漏極接第四NMOS管MN4的源極；第三NMOS管MN3的源極接地，第三NMOS管MN3的漏極接第五NMOS管MN5的源極；第四NMOS管MN4柵漏短接；第四NMOS管MN4的漏極接第三電流源I3的一端，第三電流源I3的另一端接電源；第五NMOS管MN5的柵極接第四NMOS管MN4的柵極，第五NMOS管MN5的漏極接第六PMOS管MP6的漏極；第五PMOS管MP5的源極接電源，第五PMOS管MP5的柵極接第六PMOS管MP6的柵極；第六PMOS管MP6的源極接電源；第二電流源I2、第一電容C1和第三NMOS管MN3構(gòu)成誤差放大器EA輸出的高側(cè)箝位；第三電流源I3、第二NMOS管MN2、第四NMOS管MN4、第五NMOS管MN5和第六PMOS管MP6構(gòu)成誤差放大器EA輸出的低側(cè)箝位；所述電流差分谷值限比較電路包括第六NMOS管、第七NMOS管和比較器COMP；第六NMOS管MN6的柵極接Buck功率下管的柵極驅(qū)動信號，第六NMOS管MN6的漏極接比較器COMP的正輸入端和第五PMOS管的漏極，第六NMOS管MN6的源極接地；第七NMOS管MN7的柵極接Buck功率下管的柵極驅(qū)動信號，第七NMOS管MN7的漏極接Buck功率下管NLD1的漏極，第七NMOS管MN7的源極接比較器COMP的負(fù)輸入端和第三PMOS管的漏極；比較器的輸出端接Buck的邏輯與驅(qū)動模塊。

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