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龍圖騰網(wǎng)恭喜廣東浪潮智慧計算技術有限公司申請的專利數(shù)據(jù)處理方法、FPGA加速卡及計算機可讀存儲介質(zhì)獲國家發(fā)明授權專利權，本發(fā)明授權專利權由國家知識產(chǎn)權局授予，授權公告號為：CN113867945B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權局官網(wǎng)在2025-03-21發(fā)布的發(fā)明授權授權公告中獲悉：該發(fā)明授權的專利申請?zhí)?專利號為：202111112236.0，技術領域涉及：G06F9/50；該發(fā)明授權數(shù)據(jù)處理方法、FPGA加速卡及計算機可讀存儲介質(zhì)是由張靜東;王媛麗;王江為;闞宏偉設計研發(fā)完成，并于2021-09-18向國家知識產(chǎn)權局提交的專利申請。

本數(shù)據(jù)處理方法、FPGA加速卡及計算機可讀存儲介質(zhì)在說明書摘要公布了：本發(fā)明提供一種數(shù)據(jù)處理方法，應用于FPGA加速卡，包括：數(shù)據(jù)包處理模塊對數(shù)據(jù)發(fā)送端發(fā)送的第一數(shù)據(jù)包進行解包處理得到待處理數(shù)據(jù)，并將待處理數(shù)據(jù)發(fā)送至內(nèi)核模塊；內(nèi)核模塊對待處理數(shù)據(jù)進行運算處理得到已處理數(shù)據(jù)，并將已處理數(shù)據(jù)發(fā)送至數(shù)據(jù)包處理模塊；數(shù)據(jù)包處理模塊對已處理數(shù)據(jù)進行封包處理得到第二數(shù)據(jù)包，并將第二數(shù)據(jù)包發(fā)送至數(shù)據(jù)接收端；本發(fā)明在數(shù)據(jù)包處理模塊和內(nèi)核模塊之間設置了直通的數(shù)據(jù)通路，可確保FPGA加速卡能夠直接且主動地進行數(shù)據(jù)處理及發(fā)送，可避免反復讀寫低速緩存對多加速卡加速任務的效率損耗，提升多加速卡整體的加速性能。本發(fā)明還提供一種FPGA加速卡及計算機可讀存儲介質(zhì)，具有上述有益效果。

本發(fā)明授權數(shù)據(jù)處理方法、FPGA加速卡及計算機可讀存儲介質(zhì)在權利要求書中公布了：1.一種數(shù)據(jù)處理方法，其特征在于，應用于FPGA加速卡，包括：數(shù)據(jù)包處理模塊對數(shù)據(jù)發(fā)送端發(fā)送的第一數(shù)據(jù)包進行解包處理得到待處理數(shù)據(jù)，并將所述待處理數(shù)據(jù)發(fā)送至第一時鐘模塊；所述第一時鐘模塊對所述待處理數(shù)據(jù)有序進行時鐘轉換，并將轉換后的待處理數(shù)據(jù)發(fā)送至內(nèi)核模塊；所述內(nèi)核模塊對所述待處理數(shù)據(jù)進行運算處理得到已處理數(shù)據(jù)，并將所述已處理數(shù)據(jù)發(fā)送至第二時鐘模塊；所述第二時鐘模塊對所述已處理數(shù)據(jù)進行所述時鐘轉換，并緩存轉換后的已處理數(shù)據(jù)；其中，所述第二時鐘模塊包含RAM，所述RAM用于緩存所述已處理數(shù)據(jù)；所述數(shù)據(jù)包處理模塊從所述第二時鐘模塊獲取所述轉換后的已處理數(shù)據(jù)，對所述已處理數(shù)據(jù)進行封包處理得到第二數(shù)據(jù)包，并將所述第二數(shù)據(jù)包發(fā)送至數(shù)據(jù)接收端。

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