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龍圖騰網(wǎng)獲悉上海安路信息科技股份有限公司申請的專利陣列化器件仿真網(wǎng)表的生成方法、裝置及仿真驗證方法獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN113987978B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-04-29發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202111189729.4，技術(shù)領(lǐng)域涉及：G06F30/327；該發(fā)明授權(quán)陣列化器件仿真網(wǎng)表的生成方法、裝置及仿真驗證方法是由蒙奕帆設(shè)計研發(fā)完成，并于2021-10-12向國家知識產(chǎn)權(quán)局提交的專利申請。

本陣列化器件仿真網(wǎng)表的生成方法、裝置及仿真驗證方法在說明書摘要公布了：本發(fā)明屬于陣列化器件技術(shù)領(lǐng)域，公開了一種陣列化器件仿真網(wǎng)表的生成方法、裝置及仿真驗證方法，生成方法包括：選取陣列化器件中的一個基本單元模塊作為坐標系原點，建立二維坐標系對所有模塊進行坐標標記，將基本單元模塊的坐標標記作為基本單元模塊的例化名稱，將非基本單元模塊的坐標標記和非基本單元模塊的名稱作為例化名稱，得到Verilog硬件網(wǎng)表，根據(jù)預(yù)設(shè)的資源日志對Verilog硬件網(wǎng)表進行篩選保留例化名稱記錄在資源日志中的模塊，得到與仿真案例對應(yīng)的第一網(wǎng)表。有益效果：應(yīng)用本發(fā)明的仿真網(wǎng)表生成方法可以有效降低仿真過程中的網(wǎng)表規(guī)模，進而大幅降低仿真驗證過程中的編譯時間和所需的存儲空間，大幅提高仿真驗證的效率。

本發(fā)明授權(quán)陣列化器件仿真網(wǎng)表的生成方法、裝置及仿真驗證方法在權(quán)利要求書中公布了：1.一種陣列化器件仿真網(wǎng)表的生成方法，其特征在于，包括：選取陣列化器件中的一個基本單元模塊作為坐標系原點，以坐標系原點對剩余所有的基本單元模塊進行坐標標記，得到所有基本單元模塊的坐標；所述陣列化器件包括基本單元模塊和非基本單元模塊，所述基本單元模塊為陣列化器件中陣列化次數(shù)最多且物理面積最小的模塊，非基本單元模塊的長或?qū)挒榛締卧K長或?qū)挼恼麛?shù)倍；根據(jù)基本單元模塊的坐標標記對相鄰的非基本單元模塊進行坐標標記，任意一個非基本單元模塊必定相鄰至少一個非基本單元模塊；將基本單元模塊的坐標標記作為基本單元模塊的例化名稱，將非基本單元模塊的坐標標記和非基本單元模塊的名稱作為例化名稱，得到Verilog硬件網(wǎng)表；根據(jù)預(yù)設(shè)的資源日志對Verilog硬件網(wǎng)表進行篩選保留例化名稱記錄在資源日志中的模塊，得到與仿真案例對應(yīng)的第一網(wǎng)表，所述資源日志是根據(jù)仿真案例進行編譯的；所述根據(jù)基本單元模塊的坐標標記對相鄰的非基本單元模塊進行坐標標記，具體為：當(dāng)非基本單元模塊相鄰多個基本單元模塊時，以非基本單元模塊左下角的基本單元模塊的坐標標記作為非基本單元模塊的坐標標記；若非基本單元模塊的左下角沒有基本單元模塊時，以非基本單元模塊右下角的基本單元模塊的坐標標記作為非基本單元模塊的坐標標記。

如需購買、轉(zhuǎn)讓、實施、許可或投資類似專利技術(shù)，可聯(lián)系本專利的申請人或?qū)＠麢?quán)人上海安路信息科技股份有限公司，其通訊地址為：200434 上海市虹口區(qū)紀念路500號5幢202室；或者聯(lián)系龍圖騰網(wǎng)官方客服，聯(lián)系龍圖騰網(wǎng)可撥打電話0551-65771310或微信搜索“龍圖騰網(wǎng)”。