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龍圖騰網(wǎng)恭喜無錫中微億芯有限公司申請的專利一種flash型FPGA的層次化字線預(yù)處理電路獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN114171090B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-04-15發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202111469888.X，技術(shù)領(lǐng)域涉及：G11C16/08；該發(fā)明授權(quán)一種flash型FPGA的層次化字線預(yù)處理電路是由曹正州;張艷飛;何小飛;祝潔;徐玉婷;耿楊設(shè)計(jì)研發(fā)完成，并于2021-12-03向國家知識產(chǎn)權(quán)局提交的專利申請。

本一種flash型FPGA的層次化字線預(yù)處理電路在說明書摘要公布了：本發(fā)明公開了一種flash型FPGA的層次化字線預(yù)處理電路，涉及FPGA領(lǐng)域，該方法中每個連接字線的譯碼電路由若干個形成層次化對應(yīng)結(jié)構(gòu)的控制電路控制，每個譯碼單元受控于讀寫信號、擦除信號以及對應(yīng)的各個層級的控制單元分別輸出的選擇信號，據(jù)此將字線控制信號上拉至可變正電壓或下拉至負(fù)電壓，為所連接的字線控制的存儲單元提供執(zhí)行編寫擦除、編程和讀取操作時所需的柵極電壓；層次化管理的方式簡化了譯碼電路、減少了硬件邏輯的資源開銷，且可以減少不同塊控制單元之間在對存儲單元操作時的干擾，對flash型FPGA快速集成起關(guān)鍵作用。

本發(fā)明授權(quán)一種flash型FPGA的層次化字線預(yù)處理電路在權(quán)利要求書中公布了：1.一種flash型FPGA的層次化字線預(yù)處理電路，其特征在于，所述層次化字線預(yù)處理電路包括層控制電路和一個譯碼電路，；第一層控制電路包括若干個第一控制單元，第層控制電路中的每個第控制單元對應(yīng)第層控制電路中的若干個第控制單元，為參數(shù)且，第層控制電路中的每個第控制單元對應(yīng)所述譯碼電路中的一個譯碼單元；每個譯碼單元引出字線控制信號并連接FPGA中的一個字線；每個譯碼單元受控于讀寫信號、擦除信號以及所述譯碼單元對應(yīng)的個不同層級的控制單元分別輸出的路選擇信號形成的字線選通信號，譯碼單元用于根據(jù)獲取到的信號將字線控制信號上拉至可變正電壓、為所連接的字線控制的存儲單元提供執(zhí)行讀寫操作所需的柵極電壓，以及，用于根據(jù)獲取到的信號將字線控制信號下拉至負(fù)電壓、為所連接的字線控制的存儲單元提供執(zhí)行擦除操作所需的柵極電壓。

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