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龍圖騰網(wǎng)恭喜深圳線易微電子有限公司申請(qǐng)的專利邊沿調(diào)制發(fā)射器及數(shù)字隔離器獲國(guó)家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國(guó)家知識(shí)產(chǎn)權(quán)局授予，授權(quán)公告號(hào)為：CN112803922B 。

龍圖騰網(wǎng)通過(guò)國(guó)家知識(shí)產(chǎn)權(quán)局官網(wǎng)在2025-05-13發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請(qǐng)?zhí)?專利號(hào)為：202011226532.9，技術(shù)領(lǐng)域涉及：H03K3/013；該發(fā)明授權(quán)邊沿調(diào)制發(fā)射器及數(shù)字隔離器是由李立松;方向明;伍榮翔設(shè)計(jì)研發(fā)完成，并于2020-11-05向國(guó)家知識(shí)產(chǎn)權(quán)局提交的專利申請(qǐng)。

本邊沿調(diào)制發(fā)射器及數(shù)字隔離器在說(shuō)明書摘要公布了：本申請(qǐng)?zhí)峁┮环N邊沿調(diào)制發(fā)射器及數(shù)字隔離器，涉及數(shù)字電路技術(shù)領(lǐng)域。所述邊沿調(diào)制發(fā)射器包括編碼控制電路和共模噪聲檢測(cè)電路，共模噪聲檢測(cè)電路包括至少一個(gè)多級(jí)緩沖器、至少一個(gè)電流檢測(cè)器和檢測(cè)邏輯電路，編碼控制電路包括輸入邏輯電路和脈沖延長(zhǎng)電路，檢測(cè)邏輯電路與所述脈沖延長(zhǎng)電路的連接電路、至少一個(gè)多級(jí)緩沖器連接于輸入邏輯電路和驅(qū)動(dòng)隔離器之間，至少一個(gè)電流檢測(cè)器的每個(gè)電流檢測(cè)器用于向檢測(cè)邏輯電路發(fā)送至少一個(gè)多級(jí)緩沖器的電流檢測(cè)信號(hào)，脈沖延長(zhǎng)電路連接于輸入邏輯電路與檢測(cè)邏輯電路的輸出端之間。該發(fā)射器檢測(cè)到系統(tǒng)中出現(xiàn)較大共模噪聲時(shí)，通過(guò)編碼控制電路進(jìn)行適應(yīng)性的邊沿調(diào)制。

本發(fā)明授權(quán)邊沿調(diào)制發(fā)射器及數(shù)字隔離器在權(quán)利要求書中公布了：1.一種邊沿調(diào)制發(fā)射器，其特征在于，所述邊沿調(diào)制發(fā)射器包括編碼控制電路和共模噪聲檢測(cè)電路，所述共模噪聲檢測(cè)電路包括至少一個(gè)多級(jí)緩沖器、至少一個(gè)電流檢測(cè)器和檢測(cè)邏輯電路，所述編碼控制電路包括輸入邏輯電路和脈沖延長(zhǎng)電路，所述檢測(cè)邏輯電路與所述脈沖延長(zhǎng)電路的串聯(lián)電路連接于所述至少一個(gè)多級(jí)緩沖器與所述輸入邏輯電路之間，所述至少一個(gè)多級(jí)緩沖器連接于所述輸入邏輯電路和驅(qū)動(dòng)隔離器之間，所述至少一個(gè)電流檢測(cè)器的每個(gè)電流檢測(cè)器用于向所述檢測(cè)邏輯電路發(fā)送所述至少一個(gè)多級(jí)緩沖器的電流檢測(cè)信號(hào)，所述脈沖延長(zhǎng)電路連接于所述輸入邏輯電路與所述檢測(cè)邏輯電路的輸出端之間；在所述共模噪聲檢測(cè)電路檢測(cè)到大于預(yù)設(shè)閾值的共模噪聲信號(hào)時(shí)所述檢測(cè)邏輯電路向所述脈沖延長(zhǎng)電路發(fā)送共模噪聲判定信號(hào)，所述脈沖延長(zhǎng)電路基于所述共模噪聲判定信號(hào)向所述輸入邏輯電路發(fā)送迸發(fā)信號(hào)并維持預(yù)設(shè)延時(shí)，所述輸入邏輯電路在所述迸發(fā)信號(hào)開始或結(jié)束時(shí)向所述至少一個(gè)多級(jí)緩沖器發(fā)送脈沖信號(hào)并持續(xù)所述預(yù)設(shè)延時(shí)；其中，所述輸入邏輯電路包括信號(hào)輸入端、信號(hào)輸出端和檢測(cè)輸入端，所述信號(hào)輸入端用于接收輸入信號(hào)，所述信號(hào)輸出端與所述至少一個(gè)多級(jí)緩沖器的輸入端連接，所述至少一個(gè)電流檢測(cè)器用于向所述檢測(cè)邏輯電路輸出所述至少一個(gè)多級(jí)緩沖器的所述電流檢測(cè)信號(hào)，所述檢測(cè)邏輯電路的輸出端與所述脈沖延長(zhǎng)電路的輸入端連接，所述脈沖延長(zhǎng)電路的輸出端與所述檢測(cè)輸入端連接，所述至少一個(gè)多級(jí)緩沖器的輸出端通過(guò)所述驅(qū)動(dòng)隔離器與接收器連接；所述至少一個(gè)多級(jí)緩沖器包括第一多級(jí)緩沖器和第二多級(jí)緩沖器，所述第一多級(jí)緩沖器包括第一MOS管和第二MOS管，所述第二多級(jí)緩沖器包括第三MOS管和第四MOS管，所述第一MOS管和所述第三MOS管為N型，所述第二MOS管和所述第四MOS管為P型；所述輸入邏輯電路的第一輸出端分別與所述第一MOS管以及所述第二MOS管的柵極連接，所述第一MOS管的源極分別與VDD電源以及所述檢測(cè)輸入端連接，所述第一MOS管的漏極分別與所述第二MOS管的漏極以及所述驅(qū)動(dòng)隔離器的第一輸入端連接，所述第二MOS管的源極與所述檢測(cè)輸入端連接并接地；所述輸入邏輯電路的第二輸出端分別與所述第三MOS管以及所述第四MOS管的柵極連接，所述第三MOS管的源極分別與VDD電源以及所述檢測(cè)輸入端連接，所述第三MOS管的漏極分別與所述第四MOS管的漏極以及所述驅(qū)動(dòng)隔離器的第二輸入端連接，所述第四MOS管的源極與所述檢測(cè)輸入端連接并接地；所述至少一個(gè)電流檢測(cè)器包括第一電流檢測(cè)器、第二電流檢測(cè)器、第三電流檢測(cè)器和第四電流檢測(cè)器；所述第一電流檢測(cè)器與所述第一MOS管的源極連接，所述第二電流檢測(cè)器與所述第二MOS管的源極連接，所述第三電流檢測(cè)器與所述第三MOS管的源極連接，所述第四電流檢測(cè)器與所述第四MOS管的源極連接，所述第一電流檢測(cè)器、所述第二電流檢測(cè)器、所述第三電流檢測(cè)器和所述第四電流檢測(cè)器的輸出端分別與所述檢測(cè)邏輯電路的輸入端中的第一輸入端、第二輸入端、第三輸入單和第四輸入端連接；所述第一電流檢測(cè)器包括第一電阻和第一比較器，所述第一電阻連接在所述第一MOS管的源極和VDD電源之間，所述第一比較器的兩個(gè)輸入端分別與所述第一電阻的兩端連接，所述第一比較器的輸出端與所述檢測(cè)邏輯電路的第一輸入端連接；所述第二電流檢測(cè)器包括第二電阻和第二比較器，所述第二MOS管的源極通過(guò)所述第二電阻接地，所述第二比較器的兩個(gè)輸入端分別與所述第二電阻的兩端連接，所述第二比較器的輸出端與所述檢測(cè)邏輯電路的第二輸入端連接；所述第三電流檢測(cè)器包括第三電阻和第三比較器，所述第三電流檢測(cè)器的連接方式與所述第一電流檢測(cè)器相同，所述第三比較器的輸出端與所述檢測(cè)邏輯電路的第三輸入端連接；所述第四電流檢測(cè)器包括第四電阻和第四比較器，所述第四電流檢測(cè)器的連接方式與所述第二電流檢測(cè)器相同，所述第四比較器的輸出端與所述檢測(cè)邏輯電路的第四輸入端連接；所述第一比較器、所述第二比較器、所述第三比較器和所述第四比較器具有閾值比較功能，在檢測(cè)電流大于或等于第一閾值時(shí)輸出第一邏輯，在檢測(cè)電流小于第二閾值時(shí)輸出第二邏輯。

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