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龍圖騰網(wǎng)恭喜武漢酷锘科技有限公司申請的專利一種微處理器上電過程中引腳無序狀態(tài)的時序管理方法獲國家發(fā)明授權(quán)專利權(quán)，本發(fā)明授權(quán)專利權(quán)由國家知識產(chǎn)權(quán)局授予，授權(quán)公告號為：CN114253165B 。

龍圖騰網(wǎng)通過國家知識產(chǎn)權(quán)局官網(wǎng)在2025-04-15發(fā)布的發(fā)明授權(quán)授權(quán)公告中獲悉：該發(fā)明授權(quán)的專利申請?zhí)?專利號為：202011023592.0，技術(shù)領(lǐng)域涉及：G05B19/042；該發(fā)明授權(quán)一種微處理器上電過程中引腳無序狀態(tài)的時序管理方法是由張靜;王俊波設計研發(fā)完成，并于2020-09-25向國家知識產(chǎn)權(quán)局提交的專利申請。

本一種微處理器上電過程中引腳無序狀態(tài)的時序管理方法在說明書摘要公布了：本發(fā)明公開了一種微處理器上電過程中引腳無序狀態(tài)的時序管理方法，所述一種微處理器上電過程中引腳無序狀態(tài)的時序管理方法能將微處理器上電過程中引腳無序狀態(tài)有效的確定為低電平即：邏輯“0”輸出；其電路包括一微控制器、一反相器模塊電路、一跳線。本發(fā)明電路結(jié)構(gòu)簡單，能有效的確定微處理器上電過程中輸出引腳高低電平時序，增加微處理器電路系統(tǒng)的可靠性，具有通用性，能滿足所有微處理器的應用需要。

本發(fā)明授權(quán)一種微處理器上電過程中引腳無序狀態(tài)的時序管理方法在權(quán)利要求書中公布了：1.一種微處理器上電過程中引腳無序狀態(tài)的時序管理方法，其特征在于：將微處理器上電過程中引腳的時序確定為邏輯“0”輸出；電路包括一微處理器MCU、一反相器模塊電路、一跳線J1；其中，所述的反相器模塊電路由一晶體管Q1、一上拉電阻R1、一限流電阻R2、基極對地電阻R3組成；上拉電阻R1的一端與電源VCC的一端連接，另一端分別與晶體管Q1和基極對地電阻R3的一端連接，基極對地電阻R3的另一端接地；晶體管Q1的一端與上拉電阻R1的一端連接，上拉電阻R1的另一端與電源VCC連接，晶體管Q1作為反相器模塊電路的輸出端；所述的跳線J1包括跳線管腳pin1、跳線管腳pin2和跳線管腳pin3，所述跳線管腳pin1與反相器模塊電路輸出端B連接，所述跳線管腳pin3與微處理器IO引腳端A連接，所述跳線管腳pin2為整定后的引腳時序邏輯“0”輸出端Y；對電路板進行初次上電時，跳線不插跳線帽；上電過程中，測試跳線J3的第3腳pin3的電平，即微處理器IO口的輸出電平，如果是低電平，跳線帽連接J3的pin2與pin3；低電平輸出給后端被控電路；如果是高電平，跳線帽連接J3的pin1與pin2，即微處理器IO口的電平經(jīng)反相器反相為低電平后，輸出給后端被控制電路。

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